如圖7-19所示電路，正弦電流i2的有效值I2=1A，電流i3的有效值I2=2A，因此電流i1的有效值I2等于（）。
A.
B.1+2=3A
C.2-1=1A
D.不能確定
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A.當(dāng)元件R、L、C串聯(lián)時(shí)，端口總電壓有效值一定大于每個(gè)元件電壓的有效值
B.當(dāng)元件R、L、C并聯(lián)時(shí)，L和C支路電流實(shí)際反向
C.對(duì)于感性電路，當(dāng)電源頻率f增大時(shí)，|Z|將減小
D.當(dāng)RLC串聯(lián)電路諧振時(shí)，電路電流達(dá)最小值
電路如圖7-17所示，已知I1=I2=1A，總電流I=（）A。
A.2
B.1
C.
D.
A.
B.
C.
D.
如圖7-16所示電路中，電流I1和電流I2分別為（）。
A.2.5A和1.5A
B.1A和0A
C.2.5A和0A
D.1A和1.5A
如圖7-15所示電路中，US=10V，i=1mA，則（）。
A.因?yàn)閕2=0，使電流i1=1mA
B.因?yàn)閰?shù)C未知，無(wú)法求出電流i
C.雖然電流i2未知，但是i>i1成立
D.電容存儲(chǔ)的能量為0
最新試題
由圖7-58所示數(shù)字邏輯信號(hào)的波形可知，三者的邏輯關(guān)系是（）。
基本門如圖7-61a所示，其中，數(shù)字信號(hào)A由圖7-61b給出，那么，輸出F為（）。
如圖7-72所示，時(shí)鐘到來(lái)后，JK具有（）功能。
用3個(gè)D觸發(fā)器組成的電路如圖7-69所示，觸發(fā)器F0的輸入端接+5V表明D0=1，那么，在第1個(gè)CP脈沖和第2個(gè)脈沖的上升沿過(guò)后Q2Q1Q0分別是（）。
圖7-55a所示運(yùn)算放大器的輸出與輸入之間的關(guān)系如圖7-55b所示，若Ui=2sinωtmV，則u0為（）。
邏輯表達(dá)式，可以簡(jiǎn)化為（）。
欲使JK觸發(fā)器按工作，可使JK觸發(fā)器的輸入端（）。
PLC運(yùn)行過(guò)程中，（）燈點(diǎn)亮表示CPU處于STOP（停止）模式
函數(shù)的最簡(jiǎn)式為（）。
測(cè)量常開常閉觸點(diǎn)時(shí)，需要使用萬(wàn)用表的（）