單項(xiàng)選擇題權(quán)電阻求和網(wǎng)絡(luò)DAC電路的最小輸出電壓是()。
A.0.5VLSB
B.VLSB
C.0.5VFSR
D.VFSR
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1.單項(xiàng)選擇題PLA中的與門陣列和PAL中的與門陣列分別是()的。
A.可以編程,可以編程
B.可以編程,不可以編程
C.不可以編程,可以編程
D.均不可以編程
2.單項(xiàng)選擇題對(duì)于邏輯函數(shù)的化簡(jiǎn),通常是指將邏輯函數(shù)化簡(jiǎn)成()。
A.最簡(jiǎn)或與式
B.最簡(jiǎn)與或式
C.最簡(jiǎn)或非式
D.最簡(jiǎn)與非式
3.單項(xiàng)選擇題三態(tài)門輸出高阻狀態(tài)時(shí),()說法是不正確的。
A.相當(dāng)于懸空
B.輸出端電阻極大
C.輸出電壓為0
D.輸出電壓值浮動(dòng)在OV到5V的任意數(shù)值上
4.單項(xiàng)選擇題
在圖12-5中,電路的邏輯表達(dá)式為:()。
A.A
B.B
C.C
D.D
5.單項(xiàng)選擇題下列各種門電路中哪些可以將輸出端并聯(lián)使用(輸入端的狀態(tài)不一定相同)()。
A.具有推拉式輸出級(jí)的TTL電路
B.TTL電路的OC門
C.TTL電路的三態(tài)輸出門
D.普通的CMOS門
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