A.1/3VCC
B.2/3VCC
C.VCC
D.1/2VCC
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A.產(chǎn)生矩形波
B.產(chǎn)生延遲作用
C.存儲(chǔ)器信號(hào)
D.把緩慢信號(hào)變成矩形波
A.時(shí)序邏輯
B.施密特觸發(fā)器
C.單穩(wěn)態(tài)觸發(fā)器
D.多諧振蕩器
A.電路簡(jiǎn)單
B.頻率穩(wěn)定度高
C.振蕩頻率高
D.振蕩頻率低
A.3
B.4
C.5
D.6
A.畫原始狀態(tài)轉(zhuǎn)換圖
B.進(jìn)行狀態(tài)編碼
C.求時(shí)鐘方程
D.求驅(qū)動(dòng)方程
最新試題
要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
TTL與非門閾值電壓UT的典型值是()
TTL與非門輸出低電平的參數(shù)規(guī)范值是()
一個(gè)16選一的數(shù)據(jù)選擇器,其地址輸入(選擇控制輸入)端有()個(gè)。
27系列EPROM存儲(chǔ)的數(shù)據(jù)是()可擦除的。
10-4線優(yōu)先編碼器允許同時(shí)輸入()路編碼信號(hào)。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是()可擦除的。
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù),需要增加若干個(gè)()。
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào),要求輸入每變化20mV,輸出信號(hào)的最低位(LSB)發(fā)生變化,應(yīng)選用()位ADC。