A.具有兩個能自行保持的穩(wěn)定狀態(tài)
B.有三個穩(wěn)定狀態(tài)
C.根據(jù)不同的輸入信號可以置成1或0狀態(tài)
D.沒有記憶功能
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B.主從RS觸發(fā)器
C.同步RS觸發(fā)器
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A.邊沿D觸發(fā)器
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D.邊沿D觸發(fā)器
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B.安全競爭
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D.邏輯競爭
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TTL與非門輸出低電平的參數(shù)規(guī)范值是（）
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
具有“有1出0、全0出1”功能的邏輯門是（）
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個（）。
根據(jù)什么判斷簡單電路中的險象存在？
TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
判斷如下VHDL的操作是否正確，如不正確，請改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。