A.只取決于分辨率
B.基本上是量化誤差
C.與工作中的各個(gè)環(huán)節(jié)都有關(guān)系
D.往往不可預(yù)測(cè)
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A.與非－與非表達(dá)式
B.或非－或非表達(dá)式
C.與—或—非表達(dá)式
D.標(biāo)準(zhǔn)與—或表達(dá)式
A.計(jì)算機(jī)
B.燒錄器
C.仿真器
D.開(kāi)發(fā)軟件
A.與運(yùn)算符
B.或運(yùn)算符
C.異或運(yùn)算符
D.求補(bǔ)運(yùn)算符
A.PAL
B.GAL
C.PROM
D.PLA
A.PAL
B.GAL
C.PROM
D.PLA
最新試題
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱為（）觸發(fā)器。
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
TTL與非門閾值電壓UT的典型值是（）