A.X·Y
B.
C.
D.X+Y
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A.循環(huán)冗余校驗(yàn)碼
B.海明校驗(yàn)碼
C.奇校驗(yàn)碼
D.偶校驗(yàn)碼
A.DRAM
B.EPROM
C.SRAM
D.EEPROM
A.時(shí)鐘周期大于機(jī)器周期
B.時(shí)鐘周期等于機(jī)器周期
C.機(jī)器周期大于指令周期
D.指令周期大于時(shí)鐘周期
A.7FFFH
B.8FFFH
C.9FFFH
D.AFFFH
A.算術(shù)邏輯運(yùn)算單元
B.控制器
C.通用寄存器組
D.I/O總線
最新試題
空白（2）處應(yīng)選擇（）
用（）時(shí)，校驗(yàn)位與信息位交叉設(shè)置。
若內(nèi)存按字節(jié)編址，用存儲(chǔ)容量為32K×8bit的存儲(chǔ)器芯片構(gòu)成地址編號(hào)A0000H至DFFFFH的內(nèi)存空間，則至少需要（）片。
以下關(guān)于CPU與主存之間增加高速緩存（Cache）的敘述中，錯(cuò)誤的是（）。
設(shè)內(nèi)存按字節(jié)編址，若8K×8bit存儲(chǔ)空間的起始地址為7000H，則該存儲(chǔ)空間的最大地址編號(hào)為（）。
計(jì)算機(jī)中，執(zhí)行一條指令所需要的時(shí)間稱為指令周期，完成一項(xiàng)基本操作所需要的時(shí)間稱為機(jī)器周期，時(shí)鐘脈沖的重復(fù)周期稱為時(shí)鐘周期。因此（）。
中央處理單元（CPU）不包括（）。
某邏輯電路有兩個(gè)輸入端和一個(gè)輸出端，輸入端用X和Y表示，輸出端用Z表示。當(dāng)且僅當(dāng)X和y同時(shí)為1時(shí)，Z才為0，則該電路的邏輯表達(dá)式為（）。
使用電容存儲(chǔ)信息且需要周期性地進(jìn)行刷新的存儲(chǔ)器是（）。
空白（1）處應(yīng)選擇（）